SystemVerilog Verification

课程介绍：

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SystemVerilog验证是针对数字电路验证技术初/中级学员的课程，是数字电路验证工程师必须掌握的一项基本技能。该课程不仅是对SystemVerilog的语法描述，更重要的是对SystemVerilog OOP技术的理论和用法的归纳，总结和升华，通过SystemVerilog验证课程的学习可以快速成为一名合格的IC验证工程师，构建基于SystemVerilog语言的Testbench，熟练掌握验证流程和验证工作规划，进而为掌握IC高级验证技术打下坚实的基础。

本课程适合于使用SystemVerilog进行科研和IC验证的具有初/中级水平的学生和工程师，也适合于有志于从事IC验证工作，期望进入IC验证领域的相关人员。参加学习的学员需要具有数字电路的基础知识并掌握数字逻辑仿真技术，即可完成本课程的学习。

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标签：编程 systemverilog 数字电路

课程详情：

2014-12-20 09:00

2014-12-21 09:45

• SystemVerilog 验证平台的架构

2014-12-20 10:00

2014-12-20 10:45

• Lab1：Interface, program, testbench_top 编码

2014-12-20 11:00

2014-12-20 12:00

• SystemVerilog 语义语法

2014-12-20 13:30

2014-12-20 14:15

• Lab2: OOP编码：packet, constraint

2014-12-20 14:30

2014-12-20 15:15

• SystemVerilog 并发操作机制

2014-12-20 15:30

2014-12-20 16:15

• Lab3: OOP编码：generator, driver

2014-12-20 16:30

2014-12-20 17:30

• Object Oriented Programming (OOP) 面向对象的编程

2014-12-21 09:00

2014-12-21 09:45

• Lab4: OOP编码：receiver, scoreboard

2014-12-21 10:00

2014-12-21 10:45

• SystemVerilog 内部通信机制

2014-12-21 11:00

2014-12-21 12:00

• Lab5: functional coverage and code coverage

2014-12-21 13:30

2014-12-21 14:15

• SystemVerilog Assertion

2014-12-21 14:30

2014-12-21 15:15

• Project1: Verification of an LC3 microprocessor by developing a test environment using SystemVerilog

2014-12-21 15:30

2014-12-21 16:15

• 功能覆盖率统计

2014-12-21 16:30

2014-12-21 17:30

• Project2: Verification of an LC3 microprocessor by developing a complete test environment using SystemVerilog, writing SVA and gathering functional coverage metrics.

讲师

启芯工作室

SoC设计理论及实践技能培训。

启芯工作室致力于SoC 芯片设计理论知识和实践技能的教育培训。启芯工作室由klin 老师于2013 年创建，召集了国内优秀的芯片设计工程任讲师，包括来自AMD, NVDIAD，CISCO, SONDREL 等知名公司的工程师，通过网络教育的方式进行芯片设计理论和技能的教育培训。启芯工作室通过与东南大学，上海大学微电子中心等高等学府合作推广芯片设计理论的教育。启芯注于SoC 芯片工程师培训! 启芯认为优秀的芯片设计工程师=教授级的理论水平+ 八级技工的实战技能！启芯倡导“快乐学习，轻松工作，体面生活！”